單項(xiàng)選擇題

權(quán)電阻求和網(wǎng)絡(luò)DAC電路的最小輸出電壓是（）。

A.0.5VLSB
B.VLSB
C.0.5VFSR
D.VFSR

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單項(xiàng)選擇題

PLA中的與門陣列和PAL中的與門陣列分別是（）的。

A.可以編程，可以編程
B.可以編程，不可以編程
C.不可以編程，可以編程
D.均不可以編程

單項(xiàng)選擇題

對(duì)于邏輯函數(shù)的化簡(jiǎn)，通常是指將邏輯函數(shù)化簡(jiǎn)成（）。

A.最簡(jiǎn)或與式
B.最簡(jiǎn)與或式
C.最簡(jiǎn)或非式
D.最簡(jiǎn)與非式