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單項選擇題
下圖所示電路的輸出邏輯表達(dá)式的最簡與或式為（）
A.AB’+AC’
B.AB’+ABC
C.AB’+AC
D.AB’+ABC’
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問答題
【簡答題】何謂“空翻”現(xiàn)象？抑制“空翻”可采取什么措施？
答案：
在時鐘脈沖CP＝1期間，觸發(fā)器的輸出隨輸入發(fā)生多次翻轉(zhuǎn)的現(xiàn)象稱為空翻。抑制空翻的最好措施就是讓觸發(fā)器采取邊沿觸發(fā)方式。
