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[多項選擇題]與模擬電路相比,數字系統(tǒng)的優(yōu)越性主要體現在()。
[多項選擇題]邏輯函之間滿足()關系。
[單項選擇題]?若集成塊內部為驅動單元提供的驅動能力為1X,對于下圖所示的輸出緩沖設計(圖中反相器上面標注了相應的驅動能力),該輸出單元的延遲時間(從a到y(tǒng))相當于()個內部標準門級聯的延遲時間。
[單項選擇題]若集成塊內部為驅動單元提供的驅動能力為1X,最小反相器(1X)延遲時間為2,對于下圖所示的輸出緩沖設計(圖中反相器上面標注了相應的驅動能力),該輸出單元的延遲時間(從a到y(tǒng))最接近于()。
[多項選擇題]對于D觸發(fā)器,如果時鐘頻率為10MHz,輸出信號Q的頻率可能是()MHz。
[判斷題]TTL門電路具有負載能力強、抗干擾能力強和轉換速度高等特點。
[多項選擇題]如圖電路實現的邏輯函數是()。
[單項選擇題]輸出端不能直接線與的門電路有()。
[單項選擇題]?BCD碼譯碼器如果不允許輸入大于9的數值的時候,當輸入10時,輸出為()。
[單項選擇題]如圖,是151的電路設計,其中輸入端的使用了6個反相器,而實現邏輯功能應該可以省掉三個,為什么這么設計()。
[多項選擇題]?構成數字電路最基本的器件主要有()。
[單項選擇題]電路結構如圖所示,該電路是()。
[單項選擇題]已知有二輸入邏輯門,只有當輸X和Y都為1時,輸出F才為1,則X,Y與F的邏輯關系為()。
[多項選擇題]二進制加法運算包含的輸入、輸出變量有()。
[單項選擇題]?十進制數178.5對應的余3碼是()。
[多項選擇題]?如圖所示電路論述正確的是()。
[單項選擇題]?下圖邏輯單元實現的功能為()。
[多項選擇題]關于集成塊的輸出單元,下列說法中正確的是()。
[單項選擇題]為實現將D觸發(fā)器轉換為T觸發(fā)器,下圖所示電路的虛框內應是()。
[單項選擇題]使用74HC138實現邏輯函數正確的是()。
[多項選擇題]如圖所示,則F=()。
[多項選擇題]?兩個二進制數的補碼相加,有溢出的是()。
[單項選擇題]?十進制數22.37對應的二進制數是()。
[單項選擇題]如圖,此電路的輸入端I0_L是低電平有效,輸出A2A1A0是高電平有效,AVALID有效表示的是()。
[單項選擇題]要使JK觸發(fā)器在時鐘脈沖作用下,實現輸出,則輸入信號應為()。
[單項選擇題]CC4000系列的CMOS門電路不能直接接()系列的門電路。
[單項選擇題]要使CMOS門輸入高電平,不能使用的方法為()。
[單項選擇題]?利用開關代數的公理或定理,判斷與(x+y’)’等價的邏輯關系為()。
[多項選擇題]?數字設計的層次主要有()。
[單項選擇題]?如圖電路,描述正確的是()。
[單項選擇題]已知函數F(A,B,C,D)=(AB’)’+(C’D+B’C)’,則其最簡表達式為()。
[判斷題]若n個變量的同或運算和異或運算結果相同,則n為奇數()
[單項選擇題]若集成塊內部為驅動單元提供的驅動能力為1X,最小反相器(1X)延遲時間為2,對于下圖所示的輸出緩沖設計(圖中反相器上面標注了相應的驅動能力),該輸出單元的延遲時間(從a到y(tǒng))最接近于()。
[判斷題]約束項在函數化簡時可以當作1,是因為在實際電路中,這種輸入組合根本不可能會讓其發(fā)生。
[單項選擇題]要使TTL與非門變成反相器,多余的輸入端不能采用的方法為()。
[單項選擇題]?當共陰極7段數碼管顯示2的時候,輸出應該為()。